数字钟事实上是一个对规范頻率（1HZ）开展记数的记数电源电路。因为记数的起止時间不太可能与国际标准时间（如中国北京时间）一致，故须要在电源电路上添一个校时电源电路，与此同时规范的1HZ時间数据信号务必保证精确平稳。一般应用石英石晶振电路电源电路组成数字钟。

　　简易数字钟模拟仿真原理图（一）

　　将时钟信号败给秒控制模块，秒控制模块的进位败给分控制模块，分控制模块进位键入给时控制模块，转换的过程中应用2选1数据选择器开展转换，电源电路框架图以下：

　　该方法的特点是控制模块內部简易，基本上不用另外的电源电路，但缺陷也很显著，该计划方案构造不清楚，控制模块间关联错乱，控制模块外还需应用较多逻辑门，不利功能扩充，且应用了多线程电源电路，记数在59的情况下，高一级立刻进位，故此次设计方案不采取此计划方案。

　　简易数字钟模拟仿真原理图（二）

　　时钟信号各自加到每个控制模块，每个组件作用比较单独，框架图以下：

　　该计划方案用系统总线，关键作用集中化在控制模块內部，控制模块作用比较单独，控制模块间联线简易，便于拓展，此次设计方案使用此计划方案。

　　简易数字钟模拟仿真原理图（三）

　　表明数码显示管可以一切正常颤动并进位，当整点报时电源开关开启时，在做到整时是无源蜂鸣器响；当按住校时电源开关时，数码显示管会颤动加“1”。

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