在电子线路的剖析核算中，常常依据工程观念，选用近似的核算办法。这是为了简化凌乱的实习疑问，杰出首要对立，使剖析核算得以比照顺畅地进行。在这儿，过火寻求紧密，既无必要，也不或许。可是，近似核算又有必要是合理的，有必要满意工程上对核算精度的恳求。例如，在固定偏置的拓展电路中，偏置电流如Vcc=12V,VBEQ=0.7V,则有关于Vcc，在核算时彻底能够省掉VBEQ，而以为这么做，核算过错小于十%，满意工程恳求。可是，假如 是两个数值较大而又比照挨近的电流之差：此刻榜首个除式中的VBEQ就不能疏忽，并且两个除式的核算都要比照准确，要有较多的有用数字位数，不然会得出不合理的效果。又如，在求两个电阻并联后的总电阻时，假如一个电阻比另一个大十倍以上，则能够为总电阻近似等于较小的电阻，这么的近似核算过错也不大于十%。再如，在求拓展电路的输出电阻时，管子的rec一般是和一个比它小得多的电阻（例如RC）并联。这时，由于rce>>Rc，在并联时rce就可省掉 ，而以为输出电阻RO≈Rc。可是，在晶体管恒流源中，假如省掉管子的rce，则恒流源的输出电阻Ro→∞。在这儿，rce是和一个无限大的电阻并联，当然就不能省掉。一个电阻是不是可疏忽，要看它和其它电阻比照所起效果的巨细。

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