在计数体系中，通常用的是十进制，它有0，1，2，3，…，9十个数码，用它们来构成一个数。但在数字电路中，为了把电路的两个状况(1态和0态)和数码对应起来，选用二进制较为便当，二进制只需0和1两个数码。

十进制是以十为底数的计数体系，例如

二进制是以2为底数的计数体系，例如

二进制数1十11恰当于十进制数27。

二进制加法器是数字电路的底子部件之一。二进制加法运算同逻辑加法运算的意义是纷歧样的。前者是数的运算，然后者标明逻辑联络。二进制加法是“逢二进一”，即1+1=十，而逻辑加则为1+1=1。

1、半加器

所谓“半加”，即是只求本位的和，暂不论低位送来的进位数。半加器的逻辑状况表见表1。

其间，A和B是相加的两个数，S是半加和数，C是进位数。

由逻辑状况表可写出逻辑式：

并由此画出图1(a)的逻辑图。图1(b)是半加器的逻辑符号。

(a)逻辑图	(b)逻辑符号
图1半加器逻辑图及其逻辑符号

2、全加器

当多位数相加时，半加器可用于最低位求和，并给出进位数。第二位的相加有两个待加数，还有一个来自低位送来的进位数。这三个数相加，得出本位和数(全加和数)和进位数，这即是“全加”，表2是全加器的逻辑状况表

表2全加器逻辑状况图
0 0 0 0 1 1 1 1	0 0 1 1 0 0 1 1	0 1 0 1 0 1 0 1	0 1 1 0 1 0 0 1	0 0 0 1 0 1 1 1

全加器可用两个半加器和一个或门构成，如图2(a)所示。在榜首个半加器中相加，得出的效果再和在第二个半加器中相加，即得出全加和。两个半加器的进位数经过或门输出作为本位的进位数。图2(b)是全加器的逻辑符号。

(a)逻辑图	(b)逻辑符号
图2 全加器逻辑图及其逻辑符号

例1、用4个全加器构成一个逻辑电路以完毕两个4位的二进制数A—1十1(十进制为13)和B—十11(十进制为11)的加法运算。

解：

逻辑电路如图3所示，和数是S—1十00(十进制数为24)。依据全加器的逻辑状况表自行剖析。

这种全加器的恣意一位的加法运算，都有必要比及低位加法完毕送来进位时才调进行。这种进位办法称为串行进位，它的缺陷是运算速度慢，但其电路比照简略，因而在对运算速度恳求不高的设备中，仍不失为一种可取的全加器。T692集成加法器即是这种串行加法器。

图3 例1的逻辑图

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