TTL电路是晶体管-晶体管逻辑电路的简称。TTL逻辑门由若干晶体三极管、二极管和电阻构成。下面以典型TTL与非门为例对其构造和原理作简略介绍。 图0（a）是一个典型的CT54/74系列三输入TTL与非门电路，与其对应的逻辑符号如图3.7（b）所示。

图0 典型的TTL与非门电路及逻辑符号

　　（1）电路构造

　　图0（a）所示电路按虚线差异为三有些：榜首有些由多发射极晶体管T1和电阻R1构成输入级，三个输入信号经过多发射极晶体管T1的发射结结束 “与”逻辑功用；第二有些由晶体管T2和电阻R2、R3构成基地级，由T2的集电极和发射极一同输出两个相位相反的信号别离操控T3和T5的作业状况；第三有些由晶体管T3、D4、T4和电阻R4构成推拉式输出级。输入端的D1、D2、D3用于捆绑输入端或许呈现的负极性烦扰信号，对晶体管T1起维护效果。

　　（2）作业原理

　　当电路输入端A、B、C悉数接高电平（3.6V）时，T1的集电结、T2和T4的发射结导通，T3、D4截止。因为T2的发射极向T4供应满意的基极电流，使T4处于丰满导通状况，故输出电压vF≈0.3V，即“输入全高，输出为低”。通常将这种作业状况称为导通状况，该状况下的等效电路如图1（a）所示。

图1 TTL与非门导通和到状况下的等校电路

　　当输入端A、B、C中至稀有一个接低电平（0.3V）时， T1对应于输入端接低电平的发射结导通，使T1的基极电位近似1V。该电压不或许使T2和T4导通，所以T2、T4均截止。因为T2截止，电源VCC经过R2驱动T3和D4管，使之作业在导通状况，电路输出电压近似为3.6V，即“输入有低，输出为高”。通常将电路的这种作业状况称为截止状况，该状况下的等效电路如图1（b）所示。

　　概括上述，当输入A、B、C均为高电往常，输出为低电平；当A、B、C中至稀有一个为低电往常，输出为高电平。假定高电平对应逻辑值“1”，低电平对应逻辑值“0”，则该电路结束了“与非”逻辑功用，即。

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