逐次迫临型A/D改换器原理
图 逐次迫临型A/D改换器原理图
图示电路由5个D触发器和门G1G4构成操控逻辑电路,其间5个D触发器构成环形移位寄存器;3个RS钟控触发器做为逐次迫临寄存器;三位DAC用来发作反响参阅(比照)电压Uf;门G7
G9输出三位数字量D2D1D0;C为电压比照器。
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G9输出三位数字量D2D1D0;C为电压比照器。
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