集成3-8线译码器电路图和逻辑符号
74LS138是一种集成的3-8线译码器芯片。它的逻辑电路如图1所示。
图1 3.8线译码器的电路图 |
从图1能够看出,74LS138电路除了双点画线框内的译码电路外,还包含了由GS门构成的操控电路有些。
74LS138有3个附加的操控端S0、S1、和S2。当S0=1、时,GS输出为高电平(1),译码器处于正常作业情况;不然,译码器被制止,悉数的输出被断定在高电平。这3个操控端又称“片选”输入端,运用片选的效果能够将多片联接起来以拓展译码器的功用。
表1 74LS138译码器的逻辑功用表
输入 | 输出 | |||||||||||
S0 | + | A2 | A1 | A0 | Y7 | Y6 | Y5 | Y4 | Y3 | Y2 | Y1 | Y0 |
0 | × | × | × | × | 1 | 1 | 1 | 1 | 1 | 1 | 1 | 1 |
× | 1 | × | × | × | 1 | 1 | 1 | 1 | 1 | 1 | 1 | 1 |
1 | 0 | 0 | 0 | 0 | 1 | 1 | 1 | 1 | 1 | 1 | 1 | 0 |
1 | 0 | 0 | 0 | 1 | 1 | 1 | 1 | 1 | 1 | 1 | 0 | 1 |
1 | 0 | 0 | 1 | 0 | 1 | 1 | 1 | 1 | 1 | 0 | 1 | 1 |
1 | 0 | 0 | 1 | 1 | 1 | 1 | 1 | 1 | 0 | 1 | 1 | 1 |
1 | 0 | 1 | 0 | 0 | 1 | 1 | 1 | 0 | 1 | 1 | 1 | 1 |
1 | 0 | 1 | 0 | 1 | 1 | 1 | 0 | 1 | 1 | 1 | 1 | 1 |
1 | 0 | 1 | 1 | 0 | 1 | 0 | 1 | 1 | 1 | 1 | 1 | 1 |
1 | 0 | 1 | 1 | 1 | 0 | 1 | 1 | 1 | 1 | 1 | 1 | 1 |
从表1能够看出,输入变量的每一组情况对应着一个输出端的低电平0信号,因此当输出端输出低电平0时,以为该端有信号输出,称为输出端为低电平有用,相应地输出变量的字母上面画一短线。只需当S0=1、时,译码器才处于作业情况,不然译码器不作业,输出端悉数为高电平1。因此译码器作业时,,因此称操控端、也为低电平有用,用字母上画一短线标明。图2所示为5-6-4的逻辑图形符号,输入、输出端挨近方框外的小圆圈标明低电平有用。
图2 74LS138逻辑符号 |
例1:试用两片74LS138构成4-16线译码器,将输入的4位二进制代码A3A2A1A0译成16个独立的低电平信号~。
解:由图2可知,一片74LS138芯片只需3个代码输入端A2、A1、A0,想要对4位代码进行译码,有必要用操控端来抵偿作为第4个代码输入端A3。
由74LS138的逻辑功用表1可知,操控端S0=1、时译码器才干作业,不然译码器不作业。因此,能够用第4个代码输入端A3作为高位端,经过该端的情况别离操控两片74LS138芯片的作业情况。逻辑电路如图3所示。
图3 例1的逻辑电路图 |
当然,连线的方法不止这一种,请读者自行剖析。
由表1可知,当S0=1、时,译码器处于作业情况,并且若将A2、A1、A0作为3个逻辑输入变量,则8个输出端给出的便是这3个输入变量的悉数最小项,即
(1) |
运用附加的门电路将这些最小项适本地组合起来,能够发作任何方法的三变量组合逻辑函数。
同理,由于n位二进制译码器的输出给出了n个变量的悉数最小项,因此用n变量的二进制译码器能够取得恣意方法的输入变量不大于n的组合逻辑函数。
例2:试用3-8线译码器74LS138和门电路完毕下列组合逻辑函数。
首要将给定的组合逻辑函数式化成最小项之和的方法,即
(2) |
由图1和式(1)可知,只需令74LS138的输入A2=A,A1=B,A0=C,则它的输出~就对应着式中的~。
所以将式(2)化成最小项非的方法,即
(3) |
上式标明,只需在74LS138的输出端附加3个与非门就能够得到所恳求的逻辑函数。电路的解法如图图4所示。
图4 例3的电路图 |
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