AVO、Rid对运算电路的影响

前面议论的底子运算电路中，将集成运放当作志向的，而实习的集成运放并非如此。因而，实习作业状况与志向化剖析所得的定论之间必定存在过错，即发作了运算过错。

图 1 差分输入电路

集成运放的Avd和Rid为有限值时，对运算电路将致使过错，现以图1所示的运算拓宽电路为例来议论，用图2电路来等效，
由此可列出如下方程

图2 Avd、Rid发作运算过错电路

解之可得
其间

当vS2=0，图1即为反比按例运算电路。为
通常用AVDRidR1>>Rf(R1+R2+Rid)，运用近似公式（|x|<<1时 ）上式可化简为

闭环电压增益
反比按例运算电路的志向闭环增益为
由此可得相对过错
上式阐明，AVD和Rid越大，AVF越挨近志向值，发作的过错也越小。按相似方法能够剖析同比按例运算电路。

共模按捺比KCMR对运算电路的影响

以同相运算拓宽电路为例，集成运放的共模按捺比KCMR为有限时，对运算电路致使的过错近似为
由此可见，AVD和KCMR越大，过错越小，AVF越挨近志向状况下的值。

过错推导进程
由图1的电路有
差模输入电压为
共模输入电压为
运算拓宽电路总的输出电压为
志向状况下， ，由此求得相对过错

式中 为电压反响系数。通常 ， ，
因而上式简化为 　

输入失调电压、输入失调电流对运算电路的影响

输入失调电压VIO、输入失调电流IIO不为零时，运算电路的输出电压将发作过错。依据VIO和IIO的界说，将运放用图1来等效，其间小三角符号内代表志向运放。
运用戴维南定理和诺顿定理可将两输入端化简，如图2所示，则

因为 ，有 ，则由上两式求出
因为电路中两输入端均接地，在VIO、IIB和IIO效果下，发作的输出电压VO便是必定过错。
若R2=R1//Rf，由IIB致使的过错能够消除，输出电压变为

由上式可见， 和R2越大，VIO和IIO致使的输出过错电压也越大。
当用作积分运算时，因电容C替代Rf，输出过错电压为
则
由上式可见，积分时刻常数t=R1C越小或积分时刻越长，过错越大。减小过错的方法是选用失调及温漂小的高精度、超高精度运放，或将时刻常数习气选大些。也能够在输入级加调零电位器或在输入端加一赔偿电压或赔偿电流，以抵消VIO和IIO的影响，使vO(t)为零。

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