底子rs触发器的逻辑功用、构成、逻辑状况表、逻辑符号
将两个与非门的输出端、输入端互相穿插衔接,就构成了底子R-S触发器,如下图所示。
正常作业时输出端Q和的逻辑状况相反。一般用Q端的状况来标明触发器的状况,当Q=0时称触发器为0态或复位状况,Q=1时称触发器为1态或置位状况。
下面分四种状况来谈论触发器的逻辑功用。
(1)RD=1,SD=1。设触发器处于0态,即Q=0,=1。依据触发器的逻辑电路图,此刻Q=0反响到门G2的输入端,然后确保了=1;而=1反响到门G1的输入端,与SD=1一同效果,又确保了Q=0。因此触发器仍坚持了正本的0态。
设触发器处于1态,即Q=1、=0。=0反响到门G1的输入端,然后确保了Q=1;而Q=1反响到门G2的输入端,与RD=1一同效果,又确保了=0。因此触发器仍坚持了正本的1态。
可见,不论原状况为0仍是为1,当RD和SD均为高电平常,触发用具有坚持原状况的功用,也阐明触发用具有回忆0或1的功用。正因如此,触发器能够用来寄存一位二进制数。
(2)RD=0,SD=1。当RD =0时,不论触发器正本的状况怎样,都有=1;这时门G1的两输入端都为1,则有Q=0,所以触发器置为0态。
触发器置0后,不论RD变为1或仍为0,只需SD坚持高电平(SD=1),触发器坚持0态。也即不论原状况怎样,只需SD坚持高电平,RD端加负脉冲或低电平,都能使触发器置0,因此RD端称为置0端或复位端。
(3)RD=1,SD=0。因SD=0,不论的状况怎样,都有Q=1;所以,触发器被置为1态。一旦触发器被置为1态往后,只需坚持RD =1不变,即便SD由0跳变为1,触发器仍坚持1态。SD端称为置1端或置位端。
(4)RD=0,SD=0。不论触发器正本状况怎样,只需RD、SD一同为0,都有Q==1,不契合Q和为相反的逻辑状况的请求。一旦RD和SD由低电平一同跳变为高电平,由于门的传输推迟时刻不一样,使得触发器的状况不断定。因此在运用中应当制止这种状况的发作。
综上所述得终究子R-S触发器的逻辑状况表,如下表所示。
下面分四种状况来谈论触发器的逻辑功用。
(1)RD=1,SD=1。设触发器处于0态,即Q=0,=1。依据触发器的逻辑电路图,此刻Q=0反响到门G2的输入端,然后确保了=1;而=1反响到门G1的输入端,与SD=1一同效果,又确保了Q=0。因此触发器仍坚持了正本的0态。
设触发器处于1态,即Q=1、=0。=0反响到门G1的输入端,然后确保了Q=1;而Q=1反响到门G2的输入端,与RD=1一同效果,又确保了=0。因此触发器仍坚持了正本的1态。
可见,不论原状况为0仍是为1,当RD和SD均为高电平常,触发用具有坚持原状况的功用,也阐明触发用具有回忆0或1的功用。正因如此,触发器能够用来寄存一位二进制数。
(2)RD=0,SD=1。当RD =0时,不论触发器正本的状况怎样,都有=1;这时门G1的两输入端都为1,则有Q=0,所以触发器置为0态。
触发器置0后,不论RD变为1或仍为0,只需SD坚持高电平(SD=1),触发器坚持0态。也即不论原状况怎样,只需SD坚持高电平,RD端加负脉冲或低电平,都能使触发器置0,因此RD端称为置0端或复位端。
(3)RD=1,SD=0。因SD=0,不论的状况怎样,都有Q=1;所以,触发器被置为1态。一旦触发器被置为1态往后,只需坚持RD =1不变,即便SD由0跳变为1,触发器仍坚持1态。SD端称为置1端或置位端。
(4)RD=0,SD=0。不论触发器正本状况怎样,只需RD、SD一同为0,都有Q==1,不契合Q和为相反的逻辑状况的请求。一旦RD和SD由低电平一同跳变为高电平,由于门的传输推迟时刻不一样,使得触发器的状况不断定。因此在运用中应当制止这种状况的发作。
综上所述得终究子R-S触发器的逻辑状况表,如下表所示。
底子R-S触发器的逻辑符号:
在图示的逻辑符号中,输入端挨近方框处画有“ο”,其意义是负脉冲或低电平来置位或复位。也有的底子R-S触发器选用正脉冲或高电平来置位或复位,其逻辑符号中输入端挨近方框处没有“ο”。
底子R-S触发器,尽管具有回忆和置0、置1功用,能够用来标明或存储一位二进制数码,但由于底子R-S触发器的输出状况受输入状况的直接操控,使其运用计划遭到束缚。由于一个数字体系中一般有多个触发器,因此请求用一同的信号来指挥触发器的动作,这个指挥信号是一种脉冲序列,一般称为时钟脉冲。有时钟脉冲操控的触发器叫做钟控触发器。
底子R-S触发器,尽管具有回忆和置0、置1功用,能够用来标明或存储一位二进制数码,但由于底子R-S触发器的输出状况受输入状况的直接操控,使其运用计划遭到束缚。由于一个数字体系中一般有多个触发器,因此请求用一同的信号来指挥触发器的动作,这个指挥信号是一种脉冲序列,一般称为时钟脉冲。有时钟脉冲操控的触发器叫做钟控触发器。
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