74LS112脚位图

　　引出来端标记： CLK1、CLK2 数字时钟输进端（降低沿合理）

　　J1、J2、K1、K2 数据信息输进端

　　Q1、Q2、/Q1、/Q2 輸出端

　　CLR1、CLR2 立即校准端（低电频合理）

　　PR1、PR2 立即置位端（低电频合理）

　　74LS112功能表

　　表明：H－上拉电阻

　　L－低电频

　　X－随意

　　↓－高到低电频振荡

　　Q0－稳定键入标准创建前的Q的脉冲信号

　　/Q0－稳定键入标准创建前Q的脉冲信号或Q0 的补码

　　*－不确定

　　74LS112规定值

　　电源电压------------------------------------------------7V

　　键入工作电压

　　54/74S112---------------------------------------5.5V

　　54/74LS112---------------------------------------7V

　　工作中工作温度

　　54&TImes;&TImes;&TImes;------------------------------ －55～125℃

　　74&TImes;××------------------------------------0～70℃

　　存储溫度-------------------------------------- －65～150℃

　　74LS76脚位图

　　74LS76集成电路芯片为双JK触发器，其引脚图如下图所显示。在其中J、K为触发器原理的键入端，Q、Q（－）为2个輸出端，S（－）D为置“1”端，R（－）D为置“0”端，CP为数字时钟输进端。试验中仅用其一个JK触发器。

　　（1）S（－）D、R（－）D的系统测试

　　将74LS76双JK触发器5脚插线正级（ 5V），13脚接地装置，CP端和J、K端悬在空中，R（－）D、S（－）D端各自引至数字电路设计试验机数据信息电源开关SW3、SW4，Q和Q（－）各自引至数字电路设计试验机逻辑性显示灯L1、L2。检测S（－）D、R（－）D的作用。

　　（2）逻辑性系统测试

　　将J、K端各自引至数字电路设计试验机数据信息电源开关SW1、SW2，数字时钟键入CP引至数字电路设计试验机右上方任一逻辑性电源开关（转动逻辑性电源开关等同于造成一个脉冲），SW3、SW4接R（－）D、、S（－）D，在研究操作过程中，视触发器原理置位、校准必须，需转动SW3、SW4，进而进行触发器原理的置位、校准，进行后SW3、SW4都应置上拉电阻。检测JK触发器的思维作用。

　　74LS76封裝

　　74LS112和74LS76的差别

　　74LS112和74LS76全是双J-K触发器原理，降低沿开启，带正方向輸出端和反方向輸出端，分别含有单独的开启数据信号键入、清零和置位脚位。可是它们的脚位兼容问题，就是同样作用的脚位排序部位不彻底一样（极少数脚位部位同样，如Vcc、GND、1安全通道开启数据信号键入、2安全通道K端；但其余的大部分脚位部位不一样）。

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