一般大企业硬件配置电源电路都是有降到最低设计方案，是长期性经验交流出來的，为了降低可重复性劳作和保证 产品品质。大伙儿绘图大部分立即抄控制模块电源电路，核查的人也依照规范电源电路查验，那样就不需要每一次都考虑到怎么设计方案。你觉得的晶振电路輸出串电阻器就来自于降到最低设计方案，针对数字电路设计里最重要的数字时钟源一部分，应当需注意确保信号完整性，降到最低设计方案中晶振电路外围电路除开电阻器还需要有一些别的元器件。

　　串电阻器是因为减少反射面波，防止反射面波累加造成过冲。有时候，不一样批号的木板特点不一样，留个电阻器部位有利于调节木板情况到最好。如无必需串电阻器，就用0欧电阻器联接。反射面波在绝大多数电源电路里有危害，但PCI却刚好充分利用了反射面波产生合理数据信号。

　　一、降低谐波电流，数字功放结晶輸出的是波形，这将造成谐波电流影响，尤其是特性阻抗比较严重不搭配的情形下，再加上电阻器后，该阻值将与键入电容器组成RC積分光滑电源电路，将波形变换为类似正弦波形，尽管数据信号的一致性遭受一定危害，但因为该数据信号还需要历经后续变大、整形美容后才做为时钟信号，因而，特性并不受影响，该电阻器的尺寸必须依据键入端特性阻抗、键入等效电路电容器，数字功放结晶的输出阻抗等要素挑选。

　　二、匹配电阻，减少雷达回波影响及致使的数据信号过冲。我们知道，只需特性阻抗不配对，都是会造成数据信号反射面，即雷达回波，数字功放结晶的输出阻抗一般 都很低，一般在好几百欧下列，而信号源的键入端在集成ic内部构造上一般是运算放大器的键入端，由集成ic的內部控制电路与外界的微波感应器石英谐振器组成耦合电路(应用数字功放结晶后就不用这一结晶了)，这一运算放大器的输出阻抗都是在兆欧之上。

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